全维可重构的多模态网络交换芯片架构设计

doi:10.11959/j.issn.1000-0801.2023129

电信科学 ›› 2023, Vol. 39 ›› Issue (6): 22-32.doi: 10.11959/j.issn.1000-0801.2023129

全维可重构的多模态网络交换芯片架构设计

李彧¹^,², 李召召², 吕平³, 刘勤让³

¹ 清华大学集成电路学院，北京 100084
² 网络通信与安全紫金山实验室，江苏南京 211111
³ 中国人民解放军战略支援部队信息工程大学信息技术研究所，河南郑州 450002

修回日期:2023-06-09 出版日期:2023-06-20 发布日期:2023-06-01
作者简介:李彧（1979- ），男，清华大学集成电路学院博士生、网络通信与安全紫金山实验室高级工程师，主要研究方向为网络空间安全、软件定义互连、集成电路设计
李召召（1989- ），男，博士，网络通信与安全紫金山实验室工程师，主要研究方向为网络空间安全、软件定义互连、集成电路设计
吕平（1977- ），女，博士，中国人民解放军战略支援部队信息工程大学信息技术研究所副研究员，主要研究方向为体系架构设计、软件定义互连
刘勤让（1975- ），男，博士，中国人民解放军战略支援部队信息工程大学信息技术研究所研究员、博士生导师，主要研究方向为网络空间安全、软件定义互连、集成电路设计
基金资助:
国家重点研发计划项目(2022YFB2901000)

Design on the full-dimensional reconfiguration polymorphic network switching chip architecture

Yu LI¹^,², Zhaozhao LI², Ping LYU³, Qinrang LIU³

¹ School of Integrated Circuits, Tsinghua University, Beijing 100084, China
² Purple Mountain Laboratories, Nanjing 211111, China
³ Institute of Information Technology, Information Engineering University, Zhengzhou 450002, China

Revised:2023-06-09 Online:2023-06-20 Published:2023-06-01
Supported by:
The National Key Research and Development Program of China(2022YFB2901000)

摘要/Abstract

摘要：

当前，IP 网络结构僵化、可扩展性差、安全性差。为了解决这些问题，学者们提出了多模态网络的概念，并成为当前的研究热点。可编程网络交换芯片是多模态网络的实现基础。提出了一种全维可重构的多模态网络交换芯片架构，以嵌入式 FPGA 为基础实现了多模态网络的端口级、比特级细粒度可重构，以自主设计的网络处理单元为基础实现了网络交换引擎的粗粒度可重构，使网络交换芯片具备了全维可重构的能力，为多模态网络的数据层提供了实现基础。还提出了一种改进的位矢量查找算法，能够以较小的资源占用实现较快的流表查找，提升网络交换性能，展现出较高的实用性。

关键词: 交换芯片, 多模态网络, 可重构计算

Abstract:

At present, IP network has the problems of rigid structure, poor scalability and poor security.To solve these problems, the concept of polymorphic network has been proposed by researchers and gradually become a research hotspot.The programmable network switching chip is the basis of polymorphic network implementation.Therefore, a full-dimensional reconfigurable polymorphic network switching chip architecture was proposed.Based on eFPGA in the chip, the port-level and bit-level fine-grained reconfigurable polymorphic network was realized.Based on self-designed process element (PE), the coarse-grained reconfigurable network switching engine was realized.Thereby the full-dimensional reconfigurable polymorphic network switching chip was realized and laid the foundation for the data layer of polymorphic network.To improve the network switching performance, an improved bit vector algorithm was proposed, which could realize fast flow table lookup with a smaller resource consumption.The proposed algorithm has showed its practicability in the research.

Key words: switching chip, polymorphic network, reconfigurable computing

中图分类号:

TP393

李彧, 李召召, 吕平, 刘勤让. 全维可重构的多模态网络交换芯片架构设计[J]. 电信科学, 2023, 39(6): 22-32.

Yu LI, Zhaozhao LI, Ping LYU, Qinrang LIU. Design on the full-dimensional reconfiguration polymorphic network switching chip architecture[J]. Telecommunications Science, 2023, 39(6): 22-32.

图/表 14

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参考文献 16

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协议名称	LUT6 （利用率）	REG （利用率）	BRAM （利用率）
10 Gbit/s以太网MAC	892（3.4%）	428（0.8%）	0（0%）

算法	存储容量/bit	面积/mm²
ABV	294 912	0.105 636
AFBV	294 912	0.105 636
IAFBV	49 512	0.020 502

指标	性能
面积	0.102 mm²
主频	500 MHz
典型功耗	34 mW
Core电压	0.9 V
总线宽度	128 bit

全维可重构的多模态网络交换芯片架构设计

Design on the full-dimensional reconfiguration polymorphic network switching chip architecture

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